RISC-V ist der Ausgangspunkt: eine einfache Turing-Maschine mit vollständigem Register, die Open Source ist und weit verbreitet ist. Jeder Vertrag, der geschrieben werden kann, kann mit dem RISC-V ISA abgeschlossen werden.
Die RISC-V ISA ermöglicht "benutzerdefinierte Anweisungen". Wir werden feststellen, dass viele Verträge die gleichen Berechnungen verwenden (z. B. Multiplikation von elliptischen Kurvenpunkten) und daher Seiten des RISC-V-Assemblers durch eine einzige neue benutzerdefinierte Anweisung ersetzt werden können. Und dieser Befehl kann mit speziellen Schaltkreisen innerhalb der RISC-V-Maschine ausgeführt werden (optimierter C-Code für Ethereum oder eine FPGA/ASIC-Schaltung für Nexa).
Von dieser Idee habe ich 2018 @GAndrewStone beim "Instant Transactions Workshop" am Gardasee erfahren. Andrew überzeugte mich, dass es nicht wirklich wichtig ist, wie "komplex" die Skripte anfangs sind, da Skripte, die sich als nützlich erwiesen haben, in neue "benutzerdefinierte Anweisungen" extrahiert werden können, die in Software oder Hardware optimiert werden können.
Die ETH setzt ihre ganze Hoffnung auf RISC-V
Eine Architektur, die mit allen unseren Geräten nicht kompatibel ist: Windows, Mac, Android, Intel & AMD!
Mit nur 5% der Leistung eines x64-Chips werden die Effizienzgewinne zunichte gemacht!
Sich auf spezialisierte Hardware zu verlassen, ist eine schreckliche Lösung für die Skalierung...
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